Itanium ( / aɪ ˈ t eɪ n i ə m / ; ojo -TAY -nee-əm ) es una familia descontinuada de microprocesadores Intel de 64 bits que implementan la arquitectura Intel Itanium (anteriormente llamada IA-64). La arquitectura Itanium se originó en Hewlett-Packard (HP) y luego fue desarrollada conjuntamente por HP e Intel. Lanzada en junio de 2001, Intel comercializó inicialmente procesadores para servidores empresariales y sistemas informáticos de alto rendimiento . En la fase de concepto, los ingenieros dijeron que "podríamos darle vueltas a PowerPC... podríamos acabar con el x86". Las primeras predicciones fueron que IA-64 se expandiría a los servidores de gama baja, suplantando a Xeon, y eventualmente penetraría en las computadoras personales , para eventualmente suplantar las arquitecturas de computación de conjunto de instrucciones reducido (RISC) y de computación de conjunto de instrucciones complejas (CISC) para todas las arquitecturas generales. aplicaciones de propósito.
Cuando se lanzó por primera vez en 2001, el rendimiento de Itanium fue decepcionante en comparación con los procesadores RISC y CISC mejor establecidos . La emulación para ejecutar aplicaciones y sistemas operativos x86 existentes fue particularmente deficiente. Los sistemas basados en Itanium fueron producidos por HP y su sucesor Hewlett Packard Enterprise (HPE) como la línea Integrity Servers , y por varios otros fabricantes. En 2008, Itanium fue la cuarta arquitectura de microprocesador más implementada para sistemas de clase empresarial , detrás de x86-64 , Power ISA y SPARC . [6] [ necesita actualización ]
En febrero de 2017, Intel lanzó la generación final, Kittson, para probar a los clientes y en mayo comenzó a enviarse en volumen. [7] [8] Se utilizó exclusivamente en servidores de misión crítica de HPE.
En 2019, Intel anunció que se aceptarían nuevos pedidos de Itanium hasta el 30 de enero de 2020 y que los envíos cesarían el 29 de julio de 2021. [1] Esto se llevó a cabo según lo previsto. [9]
Itanium nunca se vendió bien fuera de los servidores empresariales y los sistemas informáticos de alto rendimiento, y la arquitectura finalmente fue suplantada por la arquitectura x86-64 (también llamada AMD64) de su competidor AMD. x86-64 es una extensión compatible de la arquitectura x86 de 32 bits, implementada, por ejemplo, por la línea Xeon de Intel y la línea Opteron de AMD . Desde 2009, la mayoría de los servidores se envían con procesadores x86-64 y dominan los mercados de computadoras de escritorio y portátiles de bajo costo que inicialmente no fueron el objetivo de Itanium. [10] En un artículo titulado "El Itanium de Intel finalmente está muerto: el Itanic hundido por el gigante x86", Techspot declaró que "la promesa de Itanium terminó hundida por la falta de soporte heredado de 32 bits y las dificultades para trabajar con la arquitectura para escribir y mantener". "software", mientras que el sueño de una única ISA dominante se haría realidad con las extensiones AMD64. [11]
En 1989, HP comenzó a investigar una arquitectura que superaría los límites esperados de las arquitecturas de computadoras con conjunto de instrucciones reducido (RISC) causados por el gran aumento en la complejidad necesaria para ejecutar múltiples instrucciones por ciclo debido a la necesidad de verificación dinámica de dependencias y excepciones precisas. manejo . [c] HP contrató a Bob Rau de Cydrome y Josh Fisher de Multiflow , los pioneros de la informática de palabras de instrucción muy largas (VLIW). Una palabra de instrucción VLIW puede contener varias instrucciones independientes , que se pueden ejecutar en paralelo sin tener que evaluar su independencia. Un compilador debe intentar encontrar combinaciones válidas de instrucciones que puedan ejecutarse al mismo tiempo , realizando de manera efectiva la programación de instrucciones que los procesadores superescalares convencionales deben realizar en el hardware en tiempo de ejecución.
Los investigadores de HP modificaron el VLIW clásico en un nuevo tipo de arquitectura, más tarde denominada Computación de instrucciones explícitamente paralela (EPIC), que se diferencia por: tener bits de plantilla que muestran qué instrucciones son independientes dentro y entre los paquetes de tres instrucciones, lo que permite el paralelo explícito. ejecución de múltiples paquetes y aumento del ancho de emisión de los procesadores sin necesidad de recompilar; mediante la predicación de instrucciones para reducir la necesidad de sucursales ; y mediante enclavamiento completo para eliminar las ranuras de retardo . En EPIC, la asignación de unidades de ejecución a instrucciones y el momento de su emisión se puede decidir mediante hardware, a diferencia del VLIW clásico. HP tenía la intención de utilizar estas funciones en PA-WideWord, el sucesor previsto de su PA-RISC ISA. EPIC tenía como objetivo proporcionar el mejor equilibrio entre el uso eficiente del área de silicio y la electricidad, y la flexibilidad de uso general. [13] [14] En 1993, HP celebró un concurso interno para diseñar las mejores microarquitecturas (simuladas) de tipo RISC y EPIC, dirigido por Jerry Huck y Rajiv Gupta respectivamente. El equipo EPIC ganó, con más del doble del desempeño simulado del competidor RISC. [15]
Al mismo tiempo, Intel también buscaba formas de crear mejores ISA. En 1989 Intel lanzó el i860 , que comercializaba para estaciones de trabajo, servidores y supercomputadoras iPSC y Paragon . Se diferenciaba de otros RISC por poder cambiar entre el modo normal de instrucción única por ciclo y un modo en el que pares de instrucciones se definen explícitamente como paralelas para ejecutarlas en el mismo ciclo sin tener que realizar comprobaciones de dependencia. Otra característica distintiva fueron las instrucciones para una tubería de punto flotante expuesta, que permitieron triplicar el rendimiento en comparación con las instrucciones de punto flotante convencionales. Ambas características quedaron en gran medida sin uso porque los compiladores no las admitían, un problema que más tarde también desafió a Itanium. Sin ellos, el paralelismo (y por tanto el rendimiento) del i860 no era mejor que el de otros RISC, por lo que fracasó en el mercado. Itanium adoptaría una forma de paralelismo explícito más flexible que la que había adoptado en 1860. [dieciséis]
En noviembre de 1993, HP se acercó a Intel en busca de colaboración en una arquitectura futura innovadora. [17] [19] En ese momento, Intel buscaba extender x86 a 64 bits en un procesador con nombre en código P7, lo cual les resultó desafiante. [20] Más tarde, Intel afirmó que cuatro equipos de diseño diferentes habían explorado extensiones de 64 bits, pero cada uno de ellos concluyó que no era económicamente viable. [21] En la reunión con HP, los ingenieros de Intel quedaron impresionados cuando Jerry Huck y Rajiv Gupta presentaron la arquitectura PA-WideWord que habían diseñado para reemplazar PA-RISC . "Cuando vimos WideWord, vimos muchas cosas que sólo habíamos estado pensando en hacer, ya en todo su esplendor", dijo John Crawford de Intel , quien en 1994 se convirtió en el arquitecto jefe de Merced, y que anteriormente había argumentado en contra de extender el x86 con P7. Gupta de HP recordó: "Miré a Albert Yu [director general de microprocesadores de Intel] a los ojos y le mostré que podíamos dar vueltas alrededor de PowerPC , que podíamos acabar con PowerPC, que podíamos acabar con el x86". [22] Pronto Intel y HP comenzaron a llevar a cabo discusiones técnicas en profundidad en una oficina de HP, donde cada lado tenía seis [25] ingenieros que intercambiaron y discutieron la investigación arquitectónica confidencial de ambas compañías. Entonces decidieron utilizar no sólo PA-WideWord, sino también el más experimental HP Labs PlayDoh como fuente de su futura arquitectura conjunta. [12] [26] Convencido de la superioridad del nuevo proyecto, en 1994 Intel canceló sus planes existentes para el P7.
En junio de 1994, Intel y HP anunciaron su esfuerzo conjunto para crear una nueva ISA que adoptaría ideas de Wide Word y VLIW. Yu declaró: "Si yo fuera competidor, estaría muy preocupado. Si crees que tienes futuro, no lo tienes". [22] Sobre el futuro de P7, Intel dijo que la alianza lo impactaría, pero "no está claro" si "abarcaría completamente la nueva arquitectura". [27] [28] Más tarde, ese mismo mes, Intel dijo que algunas de las primeras características de la nueva arquitectura comenzarían a aparecer en los chips Intel ya en el P7, pero la versión completa aparecería algún tiempo después. [29] En agosto de 1994, EE Times informó que Intel había dicho a los inversores que el P7 estaba siendo reevaluado y posiblemente cancelado en favor del procesador HP. Intel inmediatamente emitió una aclaración, diciendo que P7 aún se está definiendo y que HP puede contribuir a su arquitectura. Posteriormente se confirmó que el nombre en clave P7 efectivamente había pasado al procesador HP-Intel. A principios de 1996, Intel reveló su nuevo nombre en clave, Merced . [30] [31]
HP creía que ya no era rentable para empresas individuales de sistemas empresariales como ella desarrollar microprocesadores propietarios, por lo que se asoció con Intel en 1994 para desarrollar la arquitectura IA-64, derivada de EPIC. Intel estaba dispuesta a emprender un gran esfuerzo de desarrollo en el IA-64 con la expectativa de que el microprocesador resultante sería utilizado por la mayoría de los fabricantes de sistemas empresariales. HP e Intel iniciaron un gran esfuerzo de desarrollo conjunto con el objetivo de entregar el primer producto, Merced, en 1998. [14]
Merced fue diseñado por un equipo de 500 personas, que Intel admitió más tarde que era demasiado inexperta, y muchos de ellos eran recién graduados universitarios. Crawford (Intel) fue el arquitecto jefe, mientras que Huck (HP) ocupó el segundo puesto. Al principio del desarrollo, HP e Intel tuvieron un desacuerdo en el que Intel quería más hardware dedicado para más instrucciones de punto flotante. HP prevaleció tras el descubrimiento de un error de hardware de punto flotante en el Pentium de Intel . Cuando se planificó Merced por primera vez a mediados de 1996, resultó ser demasiado grande, "esto era mucho peor que cualquier cosa que hubiera visto antes", dijo Crawford. Los diseñadores tuvieron que reducir la complejidad (y por tanto el rendimiento) de los subsistemas, incluida la unidad x86 y reducir la caché L2 a 96 KB. [d] Finalmente, se acordó que el tamaño objetivo solo podría alcanzarse utilizando el proceso de 180 nm en lugar del previsto de 250 nm . Posteriormente surgieron problemas con los intentos de acelerar los caminos críticos sin alterar la velocidad de los otros circuitos. Merced fue filmado el 4 de julio de 1999 y en agosto Intel produjo el primer chip de prueba completo. [22]
Las expectativas para Merced disminuyeron con el tiempo a medida que surgieron retrasos y deficiencias de rendimiento, cambiando el enfoque y la responsabilidad del éxito en el segundo diseño Itanium liderado por HP, con nombre en código McKinley . En julio de 1997, el cambio al proceso de 180 nm retrasó a Merced hasta la segunda mitad de 1999. [32] Poco antes de la revelación de EPIC en el Foro de Microprocesadores en octubre de 1997, un analista del Microprocessor Report dijo que Itanium "no mostraría la rendimiento competitivo hasta 2001. Será necesaria la segunda versión del chip para que se muestre el rendimiento". [33] En el Foro, Fred Pollack de Intel originó el mantra "espera a McKinley" cuando dijo que duplicaría el rendimiento del Merced y "te dejaría boquiabierto", [34] [35] mientras usaba el mismo proceso de 180 nm. como Merced. [36] Pollack también dijo que el rendimiento x86 de Merced sería inferior al de los procesadores x86 más rápidos, y que x86 "continuaría creciendo a sus tasas históricas". [34] Intel dijo que IA-64 no tendrá mucha presencia en el mercado de consumo durante 5 a 10 años. [37]
Más tarde se informó que la motivación de HP al comenzar a diseñar McKinley en 1996 era tener más control sobre el proyecto para evitar problemas que afectaran el desempeño y el cronograma de Merced. [38] [39] El equipo de diseño finalizó los objetivos del proyecto de McKinley en 1997. [40] A finales de mayo de 1998, Merced se retrasó hasta mediados de 2000, y en agosto de 1998 los analistas cuestionaban su viabilidad comercial, dado que McKinley llegaría poco después con duplicar el rendimiento, ya que los retrasos estaban provocando que Merced se convirtiera en simplemente un vehículo de desarrollo para el ecosistema Itanium. La narrativa de "esperar a McKinley" se estaba volviendo predominante. [41] El mismo día se informó que debido a los retrasos, HP ampliaría su línea de procesadores de la serie PA-RISC PA-8000 desde PA-8500 hasta PA-8900. [42] En octubre de 1998, HP anunció sus planes para cuatro generaciones más de procesadores PA-RISC, y el PA-8900 alcanzaría los 1,2 GHz en 2003. [43]
En marzo de 1999, algunos analistas esperaban que Merced enviara un volumen en volumen sólo en 2001, pero se esperaba que el volumen fuera bajo ya que la mayoría de los clientes esperarían a McKinley. [38] En mayo de 1999, dos meses antes de la finalización de Merced , un analista dijo que si no se realizaba la finalización antes de julio, se produciría otro retraso. [44] En julio de 1999, tras los informes de que el primer silicio se fabricaría a finales de agosto, los analistas predijeron un retraso hasta finales de 2000 y llegaron a un acuerdo en que Merced se utilizaría principalmente para depurar y probar el software IA-64. Linley Gwennap de MPR dijo sobre Merced que "en este punto, todos esperan que sea tarde y lento, y el verdadero avance vendrá de McKinley. Lo que esto hace es poner mucha más presión sobre McKinley y para ese equipo". para entregar". [45] Para entonces, Intel había revelado que Merced tendría un precio inicial de 5000 dólares. [46] En agosto de 1999, HP aconsejó a algunos de sus clientes que se saltearan Merced y esperaran a McKinley. [47] En julio de 2000, HP dijo a la prensa que los primeros sistemas Itanium serían para usos específicos y que "no vas a colocar estas cosas cerca de tu centro de datos durante varios años"; HP esperaba que sus sistemas Itanium se vendieran más que los sistemas PA-RISC sólo en 2005. [48] En el mismo julio Intel informó de otro retraso, debido a un cambio gradual para corregir errores. Ahora sólo se enviarían "sistemas piloto" ese año, mientras que la disponibilidad general se retrasó hasta el "primer semestre de 2001". Los fabricantes de servidores habían renunciado en gran medida al gasto en I+D para los sistemas basados en Merced, y en su lugar utilizaron placas base o servidores completos diseñados por Intel. Para fomentar un ecosistema amplio, a mediados de 2000 Intel había proporcionado 15.000 Itanium en 5.000 sistemas a desarrolladores de software y diseñadores de hardware. [49] En marzo de 2001, Intel dijo que los sistemas Itanium comenzarían a enviarse a los clientes en el segundo trimestre, seguido de un despliegue más amplio en la segunda mitad del año. Para entonces, incluso Intel reconoció públicamente que muchos clientes esperarían a McKinley. [50]
Durante el desarrollo, Intel, HP y los analistas de la industria predijeron que IA-64 dominaría primero en los servidores y estaciones de trabajo de 64 bits, luego se expandiría a los servidores de gama baja, suplantando a Xeon, y finalmente penetraría en las computadoras personales , para eventualmente suplantar a RISC. y arquitecturas de computación de conjunto de instrucciones complejas (CISC) para todas las aplicaciones de propósito general, aunque no reemplazarán a x86 "en el futuro previsible", según Intel. [53] [15] [54] [55] [56] [57] En 1997-1998, el CEO de Intel, Andy Grove, predijo que Itanium no llegaría a las computadoras de escritorio durante cuatro o cinco años después del lanzamiento, y dijo: "No "No veo a Merced aparecer en una computadora de escritorio convencional dentro de una década". [58] [15] Por el contrario, se esperaba que Itanium capturara el 70% del mercado de servidores de 64 bits en 2002. [59] Ya en 1998, el enfoque de Itanium en el segmento alto del mercado de computadoras fue criticado por hacerlo vulnerable a los rivales. expandiéndose desde los segmentos de mercado de gama baja, pero muchas personas en la industria informática temían expresar dudas sobre Itanium por temor a represalias de Intel. [15] Compaq y Silicon Graphics decidieron abandonar el desarrollo adicional de las arquitecturas Alpha y MIPS respectivamente a favor de migrar a IA-64. [60]
Varios grupos adaptaron sistemas operativos para la arquitectura, incluidos Microsoft Windows , OpenVMS , Linux , HP-UX , Solaris , [61] [62] [63] Tru64 UNIX , [60] y Monterey/64 . [64] Los tres últimos fueron cancelados antes de llegar al mercado. En 1997, era evidente que la arquitectura IA-64 y el compilador eran mucho más difíciles de implementar de lo que se pensaba originalmente, y el plazo de entrega de Merced comenzó a acortarse. [45]
Intel anunció el nombre oficial del procesador, Itanium , el 4 de octubre de 1999. [65] En cuestión de horas, el nombre Itanic había sido acuñado en un grupo de noticias de Usenet , una referencia al RMS Titanic , el transatlántico "insumergible" que se hundió en su viaje inaugural en 1912. [66] "Itanic" fue utilizado a menudo por The Register , [67] y otros, [68] [69] [70] para dar a entender que la inversión multimillonaria en Itanium, y el revuelo inicial asociado con él, sería seguido por su desaparición relativamente rápida.
Después de haber probado 40.000 chips para los socios, Intel lanzó Itanium el 29 de mayo de 2001 y los primeros sistemas OEM de HP, IBM y Dell se enviaron a los clientes en junio. [72] [73] Para entonces, el rendimiento de Itanium no era superior al de los procesadores RISC y CISC de la competencia. [74] Itanium competía en la gama baja (principalmente sistemas de cuatro CPU y más pequeños) con servidores basados en procesadores x86 , y en la gama alta con procesadores IBM POWER y Sun Microsystems SPARC . Intel reposicionó Itanium para centrarse en los mercados de computación HPC y de negocios de alto nivel , intentando duplicar el exitoso mercado "horizontal" del x86 (es decir, arquitectura única, múltiples proveedores de sistemas). El éxito de esta versión inicial del procesador se limitó a reemplazar el PA-RISC en los sistemas HP, el Alpha en los sistemas Compaq y el MIPS en los sistemas SGI , aunque IBM también entregó una supercomputadora basada en este procesador. [75] POWER y SPARC se mantuvieron fuertes, mientras que la arquitectura x86 de 32 bits continuó creciendo en el espacio empresarial, aprovechando las economías de escala impulsadas por su enorme base instalada.
Sólo se vendieron unos pocos miles de sistemas que utilizaban el procesador Merced Itanium original, debido al rendimiento relativamente pobre, el alto costo y la disponibilidad limitada de software. [76] Reconociendo que la falta de software podría ser un problema grave para el futuro, Intel puso miles de estos primeros sistemas a disposición de proveedores de software independientes (ISV) para estimular el desarrollo. HP e Intel lanzaron al mercado el procesador Itanium 2 de próxima generación un año después. Pocas de las características microarquitectónicas de Merced se trasladarían a todos los diseños posteriores de Itanium, incluido el tamaño de caché L1 de 16+16 KB y la decodificación de instrucciones de 6 anchos (dos paquetes).
El procesador Itanium 2 fue lanzado en julio de 2002 y se comercializó para servidores empresariales en lugar de para toda la gama de informática de alta gama. El primer Itanium 2, con nombre en código McKinley , fue desarrollado conjuntamente por HP e Intel, dirigido por el equipo de HP en Fort Collins, Colorado , y se lanzó en diciembre de 2000. Alivió muchos de los problemas de rendimiento del procesador Itanium original, que eran causado principalmente por un subsistema de memoria ineficiente al reducir aproximadamente a la mitad la latencia y duplicar el ancho de banda de llenado de cada uno de los tres niveles de caché, mientras se expande el caché L2 de 96 a 256 KB. Los datos de punto flotante se excluyen de la caché L1, porque el mayor ancho de banda de la caché L2 es más beneficioso para las aplicaciones típicas de punto flotante que la baja latencia. La caché L3 ahora está integrada en el chip en lugar de en una matriz separada, lo que triplica su asociatividad y duplica el ancho del bus. McKinley también aumenta en gran medida el número de combinaciones de instrucciones posibles en un paquete VLIW y alcanza una frecuencia un 25% mayor, a pesar de tener solo ocho etapas de canalización frente a las diez de Merced. [81] [40]
McKinley contiene 221 millones de transistores (de los cuales 25 millones son para lógica y 181 millones para caché L3), miden 19,5 mm por 21,6 mm (421 mm 2 ) y se fabricó en un proceso CMOS masivo de 180 nm con seis capas de metalización de aluminio. [82] [83] [84] En mayo de 2003 se reveló que algunos procesadores McKinley pueden sufrir una errata de ruta crítica que conduce a la falla del sistema. Se puede evitar bajando la frecuencia del procesador a 800 MHz. [85]
En 2003, AMD lanzó la CPU Opteron , que implementa su propia arquitectura de 64 bits llamada AMD64 . Opteron obtuvo una rápida aceptación en el espacio de servidores empresariales porque proporcionaba una fácil actualización desde x86 . Bajo la influencia de Microsoft, Intel respondió implementando la arquitectura de conjunto de instrucciones x86-64 de AMD en lugar de IA-64 en sus microprocesadores Xeon en 2004, lo que resultó en un nuevo estándar de facto para toda la industria. [60]
En 2003, Intel lanzó un nuevo miembro de la familia Itanium 2, con nombre en código Madison , inicialmente con una frecuencia de hasta 1,5 GHz y 6 MB de caché L3. El chip Madison 9M lanzado en noviembre de 2004 tenía 9 MB de caché L3 y una frecuencia de hasta 1,6 GHz, alcanzando 1,67 GHz en julio de 2005. Ambos chips utilizaron un proceso de 130 nm y fueron la base de todos los nuevos procesadores Itanium hasta el lanzamiento de Montecito en julio. 2006, específicamente Deerfield siendo un Madison de bajo vataje y Fanwood siendo una versión de Madison 9M para servidores de gama baja con uno o dos zócalos de CPU.
En noviembre de 2005, los principales fabricantes de servidores Itanium se unieron a Intel y varios proveedores de software para formar la Itanium Solutions Alliance para promover la arquitectura y acelerar el esfuerzo de portabilidad del software. [86] La Alianza anunció que sus miembros invertirían 10 mil millones de dólares en Itanium Solutions Alliance para finales de la década. [87]
A principios de 2003, debido al éxito del POWER4 de doble núcleo de IBM , Intel anunció que el primer procesador Itanium de 90 nm , con nombre en código Montecito , se retrasaría hasta 2005 para cambiarlo a doble núcleo, fusionándolo así con el Chivano . proyecto. [89] [90] En septiembre de 2004, Intel demostró un sistema Montecito en funcionamiento y afirmó que la inclusión de hyper-threading aumenta el rendimiento de Montecito en un 10-20% y que su frecuencia podría alcanzar los 2 GHz. [91] [92] Después de un retraso hasta "mediados de 2006" y una reducción de la frecuencia a 1,6 GHz, [93] el 18 de julio Intel entregó Montecito (comercializado como serie Itanium 2 9000 ), un procesador de doble núcleo con una subprocesamiento múltiple de eventos de encendido y cachés L2 divididos de 256 KB + 1 MB que aproximadamente duplicaron el rendimiento y redujeron el consumo de energía en aproximadamente un 20 por ciento. [94] Con un tamaño de matriz de 596 mm² y 1,72 mil millones de transistores, era el microprocesador más grande en ese momento. Se suponía que incluiría Foxton Technology , un regulador de frecuencia muy sofisticado, que no pasó la validación y, por lo tanto, no estaba habilitado para los clientes.
Intel lanzó la serie Itanium 9100 , con nombre en código Montvale , en noviembre de 2007, retirando la marca "Itanium 2". [95] Originalmente destinado a utilizar el proceso de 65 nm , [96] se cambió a una solución de Montecito, que permite la conmutación basada en la demanda (como EIST ) y hasta 667 MT/s de bus frontal , que estaban destinados a Montecito, además de un nivel central . [91] Montecito y Montvale fueron los últimos procesadores Itanium en cuyo diseño el equipo de ingeniería de Hewlett-Packard en Fort Collins tuvo un papel clave, ya que el equipo fue posteriormente transferido a propiedad de Intel. [97]
El nombre en clave original del primer Itanium con más de dos núcleos era Tanglewood, pero se cambió a Tukwila a finales de 2003 debido a problemas de marcas. [99] [100] Intel discutió un "Itanium de mediados de la década" para suceder a Montecito, logrando diez veces el rendimiento de Madison. [101] [90] Estaba siendo diseñado por el famoso equipo DEC Alpha y se esperaba que tuviera ocho nuevos núcleos centrados en subprocesos múltiples. Intel afirmó "mucho más que dos" núcleos y más de siete veces el rendimiento de Madison. [102] [103] [104] A principios de 2004, Intel habló de "planes para lograr hasta el doble de rendimiento que la familia de procesadores Intel Xeon con paridad de costos de plataforma para 2007". [105] A principios de 2005, Tukwila fue redefinido, ahora tiene menos núcleos pero se centra en el rendimiento de un solo subproceso y la escalabilidad multiprocesador. [106]
En marzo de 2005, Intel reveló algunos detalles de Tukwila, el próximo procesador Itanium después de Montvale, que se lanzaría en 2007. Tukwila tendría cuatro núcleos de procesador y reemplazaría el bus Itanium con una nueva interfaz de sistema común , que también sería utilizada por un Nuevo procesador Xeon. [107] Tukwila iba a tener una "arquitectura de plataforma común" con un Xeon con nombre en código Whitefield , [96] que fue cancelado en octubre de 2005, [108] cuando Intel revisó la fecha de entrega de Tukwila a finales de 2008. [109] En mayo de 2009, el El calendario para Tukwila se revisó nuevamente y el lanzamiento a los OEM está previsto para el primer trimestre de 2010. [110] El procesador de la serie Itanium 9300 , con nombre en código Tukwila , se lanzó el 8 de febrero de 2010, con mayor rendimiento y capacidad de memoria. [111]
El dispositivo utiliza un proceso de 65 nm, incluye de dos a cuatro núcleos, hasta 24 MB de caché integrada, tecnología Hyper-Threading y controladores de memoria integrados. Implementa corrección de datos de doble dispositivo , lo que ayuda a corregir errores de memoria. Tukwila también implementa Intel QuickPath Interconnect (QPI) para reemplazar la arquitectura basada en bus Itanium. Tiene un ancho de banda máximo entre procesadores de 96 GB/s y un ancho de banda máximo de memoria de 34 GB/s. Con QuickPath, el procesador tiene controladores de memoria integrados y conecta la memoria directamente, utilizando interfaces QPI para conectarse directamente a otros procesadores y concentradores de E/S. QuickPath también se utiliza en procesadores Intel x86-64 que utilizan la microarquitectura Nehalem , lo que posiblemente permitió a Tukwila y Nehalem utilizar los mismos conjuntos de chips. [112] Tukwila incorpora dos controladores de memoria, cada uno de los cuales tiene dos enlaces a búferes de memoria escalables, que a su vez admiten múltiples DIMM DDR3 , [113] muy parecido al procesador Xeon basado en Nehalem cuyo nombre en código es Beckton . [114]
Durante la demanda de soporte de Hewlett-Packard Co. contra Oracle Corp. de 2012, documentos judiciales revelados por un juez del Tribunal del Condado de Santa Clara revelaron que en 2008, Hewlett-Packard había pagado a Intel alrededor de 440 millones de dólares para seguir produciendo y actualizando microprocesadores Itanium desde 2009 hasta 2014. En 2010, las dos empresas firmaron otro acuerdo de 250 millones de dólares, que obligaba a Intel a seguir fabricando CPU Itanium para las máquinas de HP hasta 2017. Según los términos de los acuerdos, HP tenía que pagar por los chips que obtiene de Intel, mientras que Intel lanza Tukwila. , Poulson, Kittson y Kittson+ en un intento por aumentar gradualmente el rendimiento de la plataforma. [115] [116]
Intel mencionó por primera vez a Poulson el 1 de marzo de 2005, en el Spring IDF . [117] En junio de 2007, Intel dijo que Poulson utilizaría una tecnología de proceso de 32 nm , omitiendo el proceso de 45 nm . [118] Esto fue necesario para ponerse al día después de que los retrasos de Itanium lo dejaran en 90 nm compitiendo con procesadores de 65 nm y 45 nm .
En ISSCC 2011, Intel presentó un documento titulado "Un procesador Itanium de 32 nm, 3,1 mil millones de transistores y 12 ediciones de ancho para servidores de misión crítica". [119] [120] El analista David Kanter especuló que Poulson usaría una nueva microarquitectura, con una forma más avanzada de subprocesos múltiples que utiliza hasta dos subprocesos, para mejorar el rendimiento de cargas de trabajo de subprocesos únicos y múltiples. [121] También se publicó cierta información en la conferencia Hot Chips . [122] [123]
La información presentó mejoras en subprocesos múltiples, mejoras de resiliencia ( Intel Instrucción Replay RAS) y algunas instrucciones nuevas (prioridad de subprocesos, instrucción de números enteros, captación previa de caché y sugerencias de acceso a datos).
Poulson fue lanzado el 8 de noviembre de 2012 como procesador de la serie Itanium 9500 . Es el siguiente procesador de Tukwila. Cuenta con ocho núcleos y una arquitectura de 12 temas, mejoras de subprocesos múltiples y nuevas instrucciones para aprovechar el paralelismo, especialmente en la virtualización. [112] [124] [125] El tamaño de la caché Poulson L3 es de 32 MB y es común para todos los núcleos, no dividido como antes. El tamaño de la caché L2 es de 6 MB, 512 I KB , 256 D KB por núcleo. [119] El tamaño de la matriz es de 544 mm², menos que su predecesor Tukwila (698,75 mm²). [126] [127]
La Notificación de cambio de producto (PCN) 111456-01 de Intel enumera cuatro modelos de CPU de la serie Itanium 9500 , que luego se eliminó en un documento revisado. [128] Las piezas se incluyeron posteriormente en la base de datos de Hojas de datos de declaración de materiales (MDDS) de Intel. [129] Intel publicó posteriormente el manual de referencia del Itanium 9500. [130]
Los modelos son los siguientes: [128] [131]
Intel se había comprometido con al menos una generación más después de Poulson, mencionando a Kittson por primera vez el 14 de junio de 2007. [118] Se suponía que Kittson estaría en un proceso de 22 nm y usaría el mismo socket LGA2011 y plataforma que los Xeons . [132] [133] [134] El 31 de enero de 2013, Intel publicó una actualización de sus planes para Kittson: tendría el mismo zócalo LGA1248 y proceso de 32 nm que Poulson, deteniendo así cualquier desarrollo posterior de los procesadores Itanium. [135]
En abril de 2015, Intel, aunque aún no había confirmado las especificaciones formales, sí confirmó que seguía trabajando en el proyecto. [136] Mientras tanto, la agresiva plataforma multinúcleo Xeon E7 desplazó a las soluciones basadas en Itanium en la hoja de ruta de Intel. [137] Incluso Hewlett-Packard , el principal defensor y cliente de Itanium, comenzó a vender servidores Superdome y NonStop basados en x86 , y comenzó a tratar las versiones basadas en Itanium como productos heredados. [138] [139]
Intel lanzó oficialmente la familia de procesadores de la serie Itanium 9700 el 11 de mayo de 2017. [140] [8] Kittson no tiene mejoras de microarquitectura con respecto a Poulson; a pesar de tener nominalmente un paso diferente, es funcionalmente idéntico a la serie 9500, incluso teniendo exactamente los mismos errores, la única diferencia es la frecuencia 133 MHz más alta de 9760 y 9750 sobre 9560 y 9550 respectivamente. [141] [142]
Intel anunció que la serie 9700 sería el último chip Itanium producido. [7] [8]
Los modelos son: [143]
En comparación con su familia Xeon de procesadores para servidores, Itanium nunca fue un producto de gran volumen para Intel. Intel no publica cifras de producción, pero un analista de la industria estimó que la tasa de producción fue de 200.000 procesadores por año en 2007. [144]
Según Gartner Inc. , el número total de servidores Itanium (no procesadores) vendidos por todos los proveedores en 2007 fue de aproximadamente 55.000 (no está claro si los servidores agrupados cuentan como un solo servidor o no). Esto se compara con 417.000 servidores RISC (repartidos entre todos los proveedores RISC) y 8,4 millones de servidores x86. IDC informa que se vendieron un total de 184.000 sistemas basados en Itanium entre 2001 y 2007. Para el mercado combinado de sistemas POWER/SPARC/Itanium, IDC informa que POWER capturó el 42% de los ingresos y SPARC capturó el 32%, mientras que los ingresos por sistemas basados en Itanium alcanzó el 26% en el segundo trimestre de 2008. [145] Según un analista de IDC, en 2007, HP representó quizás el 80% de los ingresos por sistemas Itanium. [94] Según Gartner, en 2008, HP representó el 95% de las ventas de Itanium. [146] Las ventas del sistema Itanium de HP alcanzaron una tasa anual de 4.400 millones de dólares a finales de 2008, y disminuyeron a 3.500 millones de dólares a finales de 2009, [10] en comparación con una disminución del 35% en los ingresos por sistemas UNIX para Sun y un 11 Caída % para IBM, con un aumento de ingresos por servidores x86-64 del 14 % durante este período.
En diciembre de 2012, IDC publicó un informe de investigación que afirmaba que los envíos de servidores Itanium se mantendrían estables hasta 2016, con un envío anual de 26.000 sistemas (una disminución de más del 50 % en comparación con los envíos de 2008). [147]
En 2006, HP fabricaba al menos el 80% de todos los sistemas Itanium y vendió 7.200 en el primer trimestre de 2006. [148] La mayor parte de los sistemas vendidos fueron servidores empresariales y máquinas para informática técnica a gran escala, con un precio de venta promedio por sistema superior a 200.000 dólares EE.UU. Un sistema típico utiliza ocho o más procesadores Itanium.
En 2012, solo unos pocos fabricantes ofrecían sistemas Itanium, incluidos HP , Bull , NEC , Inspur y Huawei . Además, Intel ofreció un chasis que los integradores de sistemas podrían utilizar para construir sistemas Itanium. [149]
En 2015, solo HP suministraba sistemas basados en Itanium. [136] Con HP dividida a finales de 2015, los sistemas Itanium (con la marca Integrity ) [150] son manejados por Hewlett Packard Enterprise (HPE), con una actualización importante en 2017 (Integrity i6 y HP-UX 11i v3 Actualización 16). HPE también admite algunos otros sistemas operativos, incluidos Windows hasta Server 2008 R2, Linux , OpenVMS y NonStop . Itanium no se ve afectado por Spectre y Meltdown . [151]
Antes de la serie 9300 ( Tukwila ), se necesitaban conjuntos de chips para conectarse a la memoria principal y a los dispositivos de E/S, ya que el bus frontal del conjunto de chips era la única conexión fuera del procesador (excepto TAP ( JTAG ) y SMBus para depuración y configuración del sistema). Existieron dos generaciones de buses, el bus del sistema del procesador Itanium original (también conocido como bus Merced ) tenía un ancho de datos de 64 bits y un reloj de 133 MHz con DDR (266 MT/s), siendo pronto reemplazado por el DDR de 128 bits y 200 MHz (400 MT). /s) Bus del sistema del procesador Itanium 2 (también conocido como bus McKinley ), que luego alcanzó 533 y 667 MT/s. Se podían utilizar hasta cuatro CPU por bus, pero antes de la serie 9000, las velocidades de bus de más de 400 MT/s estaban limitadas a hasta dos procesadores por bus. [152] [153] Como ningún conjunto de chips Itanium podía conectarse a más de cuatro zócalos, los servidores de alta gama necesitaban múltiples conjuntos de chips interconectados.
El modelo de procesador Itanium "Tukwila" había sido diseñado para compartir un conjunto de chips común con el procesador Intel Xeon EX (procesador Xeon de Intel diseñado para servidores de cuatro procesadores y más grandes). El objetivo era agilizar el desarrollo de sistemas y reducir los costos para los OEM de servidores, muchos de los cuales desarrollan servidores basados tanto en Itanium como en Xeon. Sin embargo, en 2013, este objetivo se pospuso para ser "evaluado para futuras oportunidades de implementación". [154]
En la época anterior a los controladores de memoria en chip y QPI , los fabricantes de servidores empresariales diferenciaban sus sistemas diseñando y desarrollando conjuntos de chips que conectaban el procesador con la memoria, las interconexiones y los controladores periféricos. "Servidor empresarial" se refería al entonces lucrativo segmento de mercado de servidores de alta gama con alta confiabilidad, disponibilidad y capacidad de servicio y típicamente más de 16 zócalos de procesador, justificando su precio por tener una arquitectura personalizada a nivel de sistema con sus propios conjuntos de chips en su núcleo. con capacidades mucho más allá de lo que podrían ofrecer los "servidores básicos" de dos sockets. El desarrollo de un chipset cuesta decenas de millones de dólares y, por tanto, representó un importante compromiso con el uso de Itanium.
Ni Intel ni IBM desarrollarían conjuntos de chips Itanium 2 para soportar tecnologías más nuevas como DDR2 o PCI Express . [155] Antes de que "Tukwila" se alejara del FSB, todos los proveedores de servidores Itanium, como HP, Fujitsu, SGI, NEC e Hitachi, fabricaban conjuntos de chips que soportaban dichas tecnologías.
La primera generación de Itanium no recibió conjuntos de chips específicos del proveedor, solo el 460GX de Intel que consta de diez chips distintos. Admitía hasta cuatro CPU y 64 GB de memoria a 4,2 GB/s, que es el doble del ancho de banda del bus del sistema. Las direcciones y los datos eran manejados por dos chips diferentes. 460GX tenía un bus de gráficos AGP X4, dos buses PCI de 64 bits y 66 MHz y buses PCI configurables de 33 MHz duales de 32 bits o únicos de 64 bits. [156]
Hubo muchos diseños de conjuntos de chips personalizados para Itanium 2, pero muchos proveedores más pequeños optaron por utilizar el conjunto de chips E8870 de Intel. Admite 128 GB de DDR SDRAM a 6,4 GB/s. Fue diseñado originalmente para la memoria serie Rambus RDRAM , pero cuando RDRAM no tuvo éxito, Intel agregó cuatro chips convertidores DDR SDRAM a RDRAM al chipset. [157] Cuando Intel había creado previamente un convertidor de este tipo para los conjuntos de chips Pentium III 820 y 840, redujo drásticamente el rendimiento. [158] [159] E8870 proporciona ocho buses PCI-X de 133 MHz (4,2 GB/s en total debido a cuellos de botella) y un concentrador ICH4 con seis puertos USB 2.0 . Se pueden conectar dos E8870 mediante dos conmutadores de puerto de escalabilidad E8870SP, cada uno de los cuales contiene un filtro de vigilancia de 1 MB (~200 000 líneas de caché) , para crear un sistema de 8 sockets con el doble de memoria y capacidad PCI-X, pero aún así solo un ICH4. Estaba prevista una mayor ampliación a 16 enchufes. [160] [161] [162] En 2004, Intel reveló planes para que su próximo chipset Itanium, con nombre en código Bayshore , admitiera memoria PCI-e y DDR2 , pero lo canceló el mismo año. [163] [155]
HP ha diseñado cuatro conjuntos de chips diferentes para Itanium 2: zx1, sx1000, zx2 y sx2000. Todos admiten 4 sockets por chipset, pero sx1000 y sx2000 admiten la interconexión de hasta 16 chipsets para crear un sistema de hasta 64 sockets. Como fue desarrollado en colaboración con el desarrollo de Itanium 2, iniciando el primer Itanium 2 en febrero de 2001, [164] zx1 se convirtió en el primer chipset Itanium 2 disponible y más tarde en 2004 también el primero en soportar 533 MT/s FSB. En su versión básica de dos chips, proporciona directamente cuatro canales de memoria DDR-266 , lo que proporciona 8,5 GB/s de ancho de banda y 32 GB de capacidad (aunque con 12 ranuras DIMM). [165] En las versiones con placas expansoras de memoria, el ancho de banda de la memoria alcanza los 12,8 GB/s, mientras que la capacidad máxima para los expansores iniciales de 48 DIMM de dos placas era de 96 GB, y el expansor posterior de 32 DIMM de placa única de hasta 128 GB. La latencia de la memoria aumenta en 25 nanosegundos desde 80 ns debido a los expansores. Ocho enlaces independientes iban al PCI-X y otros dispositivos periféricos (por ejemplo, AGP en estaciones de trabajo), con un total de 4 GB/s. [166] [167]
El primer chipset Itanium de gama alta de HP fue el sx1000, lanzado a mediados de 2003 con el servidor insignia Integrity Superdome . Tiene dos buses frontales independientes, cada bus admite dos zócalos, lo que proporciona 12,8 GB/s de ancho de banda combinado desde los procesadores hasta el chipset. Tiene cuatro enlaces a buffers de memoria de sólo datos y admite 64 GB de memoria de 125 MHz diseñada por HP a 16 GB/s. Los componentes anteriores forman una placa del sistema llamada celda . Se pueden conectar dos celdas directamente entre sí para crear un sistema sin pegamento de 8 enchufes . Para conectar cuatro celdas entre sí, se necesita un par de interruptores de barra transversal de 8 puertos (que agregan 64 ns a los accesos a la memoria entre celdas), mientras que se necesitan cuatro pares de interruptores de barra transversal para el sistema de gama alta de 16 celdas (64 zócalos). , lo que proporciona 32 GB/s de ancho de banda de bisección . Las celdas mantienen la coherencia de la caché a través de directorios en memoria , lo que hace que la latencia mínima de la memoria sea de 241 ns. La latencia hasta la memoria más remota ( NUMA ) es de 463 ns. El ancho de banda por celda para los subsistemas de E/S es de 2 GB/s, a pesar de la presencia de buses PCI-X de 8 GB/s en cada subsistema de E/S. [168] [169] [170]
HP lanzó el sx2000 en marzo de 2006 para suceder al sx1000. Sus dos FSB funcionan a 533 MT/s. Admite hasta 128 GB de memoria a 17 GB/s. La memoria es de diseño personalizado de HP, utiliza el protocolo DDR2 , pero dos veces más alta que los módulos estándar y con contactos redundantes de dirección y señal de control. Para la comunicación entre chipsets, hay 25,5 GB/s disponibles en cada sx2000 a través de sus tres enlaces serie que pueden conectarse a un conjunto de tres barras transversales independientes , que se conectan a otras celdas o hasta a otros 3 conjuntos de 3 barras transversales. Las configuraciones de múltiples celdas son las mismas que con sx1000, excepto que el paralelismo de los conjuntos de barras transversales se ha incrementado de 2 a 3. La configuración máxima de 64 sockets tiene 72 GB/s de ancho de banda de bisección sostenible . La conexión del chipset a su módulo de E/S ahora es en serie con un pico de 8,5 GB/s y un ancho de banda sostenido de 5,5 GB/s; el módulo de E/S tiene 12 buses PCI-X de hasta 266 MHz o 6 PCI-X. buses y 6 ranuras PCIe 1.1×8. Es el último conjunto de chips compatible con los procesadores PA-RISC de HP ( PA-8900 ). [171]
HP lanzó los primeros servidores basados en zx2 en septiembre de 2006. zx2 puede operar el FSB a 667 MT/s con dos CPU o 533 MT/s con cuatro CPU. Se conecta a la memoria DDR2 directamente, admitiendo 32 GB a hasta 14,2 GB/s, o mediante placas expansoras, admitiendo hasta 384 GB a 17 GB/s. La latencia mínima de página abierta es de 60 a 78 ns. Hay 9,8 GB/s disponibles a través de ocho enlaces independientes a los adaptadores de E/S, que pueden incluir PCIe ×8 o PCI-X de 266 MHz. [172] [173]
En mayo de 2003, IBM lanzó el chipset XA-64 para Itanium 2. Utilizaba muchas de las mismas tecnologías que las dos primeras generaciones de chipsets XA-32 para Xeon , pero en el momento de la tercera generación XA-32, IBM había decidido descontinuar sus productos Itanium. XA-64 admitía 56 GB de DDR SDRAM en 28 ranuras a 6,4 GB/s, aunque debido a cuellos de botella sólo 3,2 GB/s podían ir a la CPU y otros 2 GB/s a los dispositivos para un total de 5,2 GB/s. El cuello de botella de la memoria de la CPU fue mitigado por una caché DRAM L4 de 64 MB fuera del chip, que también funcionó como un filtro de vigilancia en sistemas con múltiples chipsets. El ancho de banda combinado de los cuatro buses PCI-X y otras E/S tiene un cuello de botella de 2 GB/s por chipset. Se pueden conectar dos o cuatro conjuntos de chips para crear un sistema de 8 o 16 zócalos. [174]
Las supercomputadoras y servidores Altix de SGI utilizaron el chipset SHUB (Super-Hub), que admite dos zócalos Itanium 2. La versión inicial utilizaba memoria DDR a través de cuatro buses para un ancho de banda de hasta 12,8 GB/s y hasta 32 GB de capacidad en 16 ranuras. Un canal XIO de 2,4 GB/s conectado a un módulo con hasta seis buses PCI-X de 64 bits y 133 MHz . Los SHUB se pueden interconectar mediante planos de enlace duales NUMAlink 4 de 6,4 GB/s para crear un sistema de imagen única coherente con caché de 512 sockets. Un caché para el directorio de coherencia en memoria ahorra ancho de banda de la memoria y reduce la latencia. La latencia a la memoria local es de 132 ns y cada cruce de un enrutador NUMAlink4 agrega 50 ns. Los módulos de E/S con cuatro buses PCI-X de 133 MHz se pueden conectar directamente a la red NUMAlink4. [175] [176] [177] [178] El chipset SHUB 2.0 de segunda generación de SGI admitía hasta 48 GB de memoria DDR2 , 667 MT/s FSB y podía conectarse a módulos de E/S que proporcionaban PCI Express . [179] [180] Solo admite cuatro subprocesos locales, por lo que cuando se tienen dos CPU de doble núcleo por chipset, se debe desactivar Hyper-Threading . [181]
El Proyecto Trillian fue un esfuerzo de un consorcio industrial para portar el kernel de Linux al procesador Itanium. El proyecto comenzó en mayo de 1999 con el objetivo de lanzar la distribución a tiempo para el lanzamiento inicial de Itanium, entonces programado para principios de 2000. [184] A finales de 1999, el proyecto incluía Caldera Systems , CERN , Cygnus Solutions , Hewlett- Sistemas Packard , IBM , Intel , Red Hat , SGI , SuSE , TurboLinux y VA Linux . [185] El proyecto lanzó el código resultante en febrero de 2000. [184] El código luego pasó a formar parte del núcleo principal de Linux más de un año antes del lanzamiento del primer procesador Itanium. El proyecto Trillian pudo hacer esto por dos razones:
Después de la finalización exitosa del Proyecto Trillian, el kernel de Linux resultante fue utilizado por todos los fabricantes de sistemas Itanium ( HP , IBM , Dell , SGI , Fujitsu , Unisys , Hitachi y Groupe Bull ). Con la notable excepción de HP, Linux es el sistema operativo principal o el único que el fabricante admite para Itanium. Posteriormente, en Gelato se fusionó el soporte continuo de software gratuito y de código abierto para Linux en Itanium .
En 2005, Fedora Linux comenzó a agregar soporte para Itanium [187] y Novell agregó soporte para SUSE Linux. [188] En 2007, CentOS agregó soporte para Itanium en una nueva versión. [189]
En 2009, Red Hat eliminó el soporte para Itanium en Enterprise Linux 6. [192] Ubuntu 10.10 eliminó el soporte para Itanium. [193] En 2021, Linus Torvalds marcó el código Itanium como huérfano. Torvalds dijo:
"HPE ya no acepta pedidos de nuevo hardware Itanium e Intel dejó de aceptar pedidos hace un año. Si bien Intel todavía enviará chips oficialmente hasta el 29 de julio de 2021, es poco probable que tales pedidos existan realmente. Está muerto, Jim ". [194] [195]
La compatibilidad con Itanium se eliminó en Linux 6.7. [196] [197]
En 2001, Compaq anunció que OpenVMS sería portado a la arquitectura Itanium. [198] Esto llevó a la creación de las versiones V8.x de OpenVMS, que admiten tanto servidores HPE Integrity basados en Itanium como hardware DEC Alpha . [199] Desde que comenzó el esfuerzo de portabilidad de Itanium, la propiedad de OpenVMS se transfirió de Compaq a HP en 2001, y luego a VMS Software Inc. (VSI) en 2014. [200] Los lanzamientos dignos de mención incluyen:
La compatibilidad con Itanium se ha eliminado en las versiones V9.x de OpenVMS, que se ejecutan únicamente en x86-64. [202]
NonStop OS se transfirió desde hardware basado en MIPS a Itanium en 2005. [203] NonStop OS se transfirió posteriormente a x86-64 en 2015. Las ventas de hardware NonStop basado en Itanium finalizaron en 2020 y el soporte finalizó en 2025. [204] [ 205]
GNU Compiler Collection dejó de ser compatible con IA-64 en GCC 10, después de que Intel anunciara la eliminación planificada de esta ISA. [206] LLVM (Clang) eliminó el soporte para Itanium en la versión 2.6. [207]
HP vende una tecnología de virtualización para Itanium llamada Integrity Virtual Machines .
La emulación es una técnica que permite a una computadora ejecutar código binario que fue compilado para un tipo diferente de computadora. Antes de la adquisición de QuickTransit por parte de IBM en 2009, el software binario de aplicación para IRIX / MIPS y Solaris / SPARC podía ejecutarse mediante un tipo de emulación llamada "traducción binaria dinámica" en Linux/Itanium. De manera similar, HP implementó un método para ejecutar PA-RISC/HP-UX en Itanium/HP-UX mediante emulación, para simplificar la migración de sus clientes de PA-RISC al conjunto de instrucciones Itanium radicalmente diferente. Los procesadores Itanium también pueden ejecutar el entorno mainframe GCOS de Groupe Bull y varios sistemas operativos x86 mediante simuladores de conjuntos de instrucciones .
Itanium estaba dirigido a los mercados de servidores empresariales y de informática de alto rendimiento (HPC). Otras líneas de procesadores centradas en empresas y HPC incluyen los procesadores SPARC de Oracle y Fujitsu y los microprocesadores Power de IBM . Medido por la cantidad vendida, la competencia más seria de Itanium provino de los procesadores x86-64 , incluida la línea Xeon de Intel y la línea Opteron de AMD . Desde 2009, la mayoría de los servidores se enviaban con procesadores x86-64. [10]
En 2005, los sistemas Itanium representaron alrededor del 14% de los ingresos por sistemas HPC, pero el porcentaje disminuyó a medida que la industria pasó a clústeres x86-64 para esta aplicación. [208]
Un informe de Gartner de octubre de 2008 sobre el procesador Tukwila declaró que "... la hoja de ruta futura para Itanium parece tan sólida como la de cualquier par RISC como Power o SPARC". [209]
Una computadora basada en Itanium apareció por primera vez en la lista de las supercomputadoras TOP500 en noviembre de 2001. [75] La mejor posición jamás lograda por un sistema basado en Itanium 2 en la lista fue la número 2, lograda en junio de 2004, cuando Thunder ( Lawrence Livermore National Laboratory ) entró en la lista con un Rmax de 19,94 Teraflops. En noviembre de 2004, Columbia entró en la lista en el puesto número 2 con 51,8 Teraflops, y hubo al menos una computadora basada en Itanium entre las 10 primeras desde entonces hasta junio de 2007. El número máximo de máquinas basadas en Itanium en la lista se produjo en el lista de noviembre de 2004, en 84 sistemas (16,8%); en junio de 2012, esta cifra se había reducido a un sistema (0,2%), [210] y en noviembre de 2012 no quedaba ningún sistema Itanium en la lista.
Los procesadores Itanium muestran una progresión en capacidad. Merced fue una prueba de concepto. McKinley mejoró drásticamente la jerarquía de la memoria y permitió que Itanium se volviera razonablemente competitivo. Madison, con el cambio a un proceso de 130 nm, permitió suficiente espacio de caché para superar los principales cuellos de botella de rendimiento. Montecito, con un proceso de 90 nm, permitió una implementación de doble núcleo y una mejora importante en el rendimiento por vatio. Montvale agregó tres características nuevas: bloqueo a nivel de núcleo, conmutación basada en la demanda y frecuencia de bus frontal de hasta 667 MHz.
Cuando se lanzó por primera vez en 2001, el rendimiento de Itanium fue decepcionante en comparación con los procesadores RISC y CISC mejor establecidos . [56] [57] La emulación para ejecutar aplicaciones y sistemas operativos x86 existentes era particularmente deficiente; un punto de referencia en 2001 informó que era equivalente, en el mejor de los casos, a un Pentium de 100 MHz en este modo ( en ese momento había Pentium de 1,1 GHz en el mercado). ). [215] Itanium no logró avances significativos contra IA-32 o RISC, y sufrió aún más tras la llegada de sistemas x86-64 que ofrecían una mayor compatibilidad con aplicaciones x86 más antiguas.
En un artículo de 2009 sobre la historia del procesador, "Cómo el Itanium acabó con la industria informática", el periodista John C. Dvorak informó: "Este sigue siendo uno de los grandes fiascos de los últimos 50 años". [216] La columnista tecnológica Ashlee Vance comentó que los retrasos y el bajo rendimiento "convirtieron el producto en una broma en la industria de los chips". [146] En una entrevista, Donald Knuth dijo: "El enfoque de Itanium... se suponía que era fantástico, hasta que resultó que los compiladores deseados eran básicamente imposibles de escribir". [217]
Tanto Red Hat como Microsoft anunciaron planes para eliminar el soporte de Itanium en sus sistemas operativos debido a la falta de interés del mercado; [218] [219] sin embargo, otras distribuciones de Linux como Gentoo y Debian siguen disponibles para Itanium. El 22 de marzo de 2011, Oracle Corporation anunció que ya no desarrollaría nuevos productos para HP-UX en Itanium, aunque continuaría brindando soporte para productos existentes. [220] Después de este anuncio, HP demandó a Oracle por incumplimiento de contrato, argumentando que Oracle había violado las condiciones impuestas durante el acuerdo sobre la contratación por parte de Oracle del ex director ejecutivo de HP, Mark Hurd , como su codirector ejecutivo, exigiendo que el proveedor respaldara a Itanium en su software "hasta en el momento en que HP suspenda las ventas de sus servidores basados en Itanium", [221] y que la infracción había perjudicado su negocio. En 2012, un tribunal falló a favor de HP y ordenó a Oracle que reanudara su apoyo a Itanium. En junio de 2016, Hewlett Packard Enterprise (el sucesor corporativo del negocio de servidores de HP) recibió 3 mil millones de dólares en daños y perjuicios a raíz de la demanda. [222] [223] Oracle apeló sin éxito la decisión ante el Tribunal de Apelaciones de California en 2021. [224]
Un ex funcionario de Intel informó que el negocio Itanium se había vuelto rentable para Intel a finales de 2009. [225] En 2009, el chip se implementó casi por completo en servidores fabricados por HP, que tenía más del 95% de la participación de mercado de servidores Itanium, [146 ] creando el sistema operativo principal para Itanium HP-UX . El 22 de marzo de 2011, Intel reafirmó su compromiso con Itanium con múltiples generaciones de chips en desarrollo y según lo programado. [226]
Aunque Itanium logró un éxito limitado en el nicho de mercado de la informática de alta gama, Intel originalmente esperaba que encontraría una aceptación más amplia como reemplazo de la arquitectura x86 original . [227]
AMD eligió una dirección diferente, diseñando el x86-64 menos radical , una extensión de 64 bits de la arquitectura x86 existente, que luego Microsoft admitió, lo que obligó a Intel a introducir las mismas extensiones en sus propios procesadores basados en x86. [228] Estos diseños pueden ejecutar aplicaciones de 32 bits existentes a la velocidad del hardware nativo, al tiempo que ofrecen soporte para direccionamiento de memoria de 64 bits y otras mejoras para nuevas aplicaciones. [146] Esta arquitectura se ha convertido ahora en la arquitectura de 64 bits predominante en el mercado de computadoras de escritorio y portátiles. Aunque algunas estaciones de trabajo basadas en Itanium fueron introducidas inicialmente por empresas como SGI , ya no están disponibles.
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...la serie 9700 será el último procesador Intel Itanium.
...los desarrolladores pueden desarrollar rápidamente aplicaciones hoy en día que serán compatibles y podrán ajustarse fácilmente a Solaris en Merced.
{{cite web}}: Mantenimiento CS1: URL no apta ( enlace ){{cite web}}: Mantenimiento CS1: URL no apta ( enlace ){{cite web}}: Mantenimiento CS1: URL no apta ( enlace )KitGuru dice: Aunque es muy probable que se lancen chips "Kittson", no parece que Intel y HP realmente quieran invertir dinero en investigación y desarrollo para aumentar el rendimiento de los chips IA-64.
Como resultado, parece que lo mejor que ofrecerá "Kittson" será una mejora del rendimiento del 20 por ciento con respecto a las ofertas de la generación actual.
El Proyecto Gentoo/IA-64 trabaja para mantener a Gentoo como la distribución IA-64 más actualizada y rápida disponible.
{{cite web}}: Mantenimiento CS1: URL no apta ( enlace )Una vez promocionado por Intel como un reemplazo para la línea de productos x86, las expectativas para Itanium se han reducido considerablemente.
{{cite web}}: Mantenimiento CS1: URL no apta ( enlace )Windows Server 2008 R2 será la última versión de Windows Server compatible con la arquitectura Intel Itanium", [...] "SQL Server 2008 R2 y Visual Studio 2010 son también las últimas versiones compatibles con Itanium.
