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Módulo multichip

Un módulo cerámico multichip que contiene cuatro procesadores POWER5 (centro) y cuatro módulos de caché L3 de 36 MB (periferia)

Un módulo multichip ( MCM ) es genéricamente un conjunto electrónico (como un paquete con varios terminales conductores o "pines" ) donde se colocan múltiples circuitos integrados (CI o "chips"), matrices semiconductoras y/u otros componentes discretos. integrado, generalmente sobre un sustrato unificador, de modo que en uso pueda tratarse como si fuera un CI más grande. [1] Otros términos para el empaquetado MCM incluyen "integración heterogénea" o " circuito integrado híbrido ". [2] La ventaja de usar empaques MCM es que permite al fabricante usar múltiples componentes para lograr modularidad y/o mejorar el rendimiento con respecto a un enfoque de circuitos integrados monolíticos convencionales.

Un módulo multichip Flip Chip ( FCMCM ) es un módulo multichip que utiliza tecnología de chip invertido . Un FCMCM puede tener un troquel grande y varios troqueles más pequeños, todos en el mismo módulo. [3]

Descripción general

Los módulos multichip vienen en una variedad de formas dependiendo de la complejidad y las filosofías de desarrollo de sus diseñadores. Estos pueden variar desde el uso de circuitos integrados preempaquetados en una pequeña placa de circuito impreso (PCB) destinada a imitar la huella de un paquete de chips existente hasta paquetes de chips totalmente personalizados que integran muchas matrices de chips en un sustrato de interconexión de alta densidad (HDI). El sustrato MCM ensamblado final se puede realizar de una de las siguientes maneras:

Los IC que componen el paquete MCM pueden ser:

La PCB que interconecta los circuitos integrados se conoce como intercalador . Esto suele ser orgánico (una placa de circuito laminada, que contiene carbono, por lo tanto orgánico ) o está hecho de silicio (como en la memoria de alto ancho de banda ) [6] . Ambos tienen sus ventajas y limitaciones. El uso de interposers para conectar varios circuitos integrados en lugar de conectar varios circuitos integrados monolíticos en paquetes separados reduce la potencia necesaria para transmitir señales entre circuitos integrados, aumenta la cantidad de canales de transmisión y reduce los retrasos causados ​​por la resistencia/capacitancia (retrasos de RC). [7] Sin embargo, la comunicación entre chiplets consume más energía y tiene una latencia más alta que los componentes dentro de circuitos integrados monolíticos. [8]

MCM de pila de chips

NoC inalámbrico en circuito integrado 3D

Un desarrollo relativamente nuevo en la tecnología MCM es el llamado paquete "chip-stack". [9] Ciertos circuitos integrados, en particular las memorias, tienen configuraciones de pines muy similares o idénticas cuando se usan varias veces dentro de los sistemas. Un sustrato cuidadosamente diseñado puede permitir que estos troqueles se apilen en una configuración vertical, lo que hace que la huella del MCM resultante sea mucho más pequeña (aunque a costa de un chip más grueso o más alto). Dado que el espacio suele ser un bien escaso en los diseños de electrónica en miniatura, la pila de chips es una opción atractiva en muchas aplicaciones, como teléfonos móviles y asistentes digitales personales (PDA). Con el uso de un circuito integrado 3D y un proceso de adelgazamiento, se pueden apilar hasta diez matrices para crear una tarjeta de memoria SD de alta capacidad. [10] Esta técnica también se puede utilizar para memoria de alto ancho de banda .

La forma posible de aumentar el rendimiento de la transferencia de datos en la pila de chips es utilizar redes inalámbricas en chip (WiNoC). [11]

Ejemplos de paquetes multichip

Módulos multichip 3D

Ver también

Referencias

  1. ^ Rao Tummala, Tecnología de estado sólido. "SoC frente a MCM frente a SiP frente a SoP", obtenido el 4 de agosto de 2015.
  2. ^ Don Scansen, EE Times "Chiplets: una breve historia obtenido el 26 de abril de 2021
  3. ^ "IMAPS Advancing Microelectronics 2020 Número 3 (SiP avanzado)". Libro volteado . Consultado el 5 de diciembre de 2023 .
  4. ^ Samuel K. Moore, IEEE Spectrum "La visión de Intel de la revolución de los chiplets" Consultado el 26 de abril de 2021.
  5. ^ "Chiplets" de semiingeniería obtenido el 26 de abril de 2021
  6. ^ "2.5D - Ingeniería de semiconductores". Semiingeniería.com . Consultado el 13 de mayo de 2022 .
  7. ^ "Intercaladores".
  8. ^ Dr. Ian Cutress, AnandTech "Intel pasa a chiplets: 'Cliente 2.0' para 7 nm"
  9. ^ Jon Worrel (15 de abril de 2012). "Intel migra a módulos multichip (MCM) de escritorio con Broadwell de 14 nm". Fudzilla .
  10. ^ Richard Chirgwin, El registro. "Los proveedores de memoria apuestan por el estándar de apilamiento '3D'". 2 de abril de 2013. Recuperado 5 de febrero de 2016.
  11. ^ Slyusar VI, Slyusar DV Diseño piramidal de matriz de nanoantenas. // VIII Congreso Internacional sobre Teoría y Técnicas de Antenas (ICATT'11). - Kyiv, Ucrania. - Universidad Técnica Nacional de Ucrania “Instituto Politécnico de Kiev”. - 20 al 23 de septiembre de 2011. - Pp. 140 - 142. [1]
  12. ^ Ghoshal, U.; Van Duzer, T. (1992). "Circuitos de interconexión MCM de alto rendimiento y fluxoelectrónica". Actas de la Conferencia de módulos multichip IEEE de 1992 MCMC-92 . págs. 175-178. doi :10.1109/MCMC.1992.201478. ISBN 0-8186-2725-5. S2CID  109329843.
  13. ^ Quemaduras, MJ; Char, K.; Cole, BF; Rubí, WS; Sachtjen, SA (1993). "Módulo multichip que utiliza interconexiones YBa2Cu3O7−δ multicapa". Letras de Física Aplicada . 62 (12): 1435-1437. Código bibliográfico : 1993ApPhL..62.1435B. doi :10.1063/1.108652.
  14. ^ Satoru Iwata, pregunta Iwata. "Cambios en la televisión". Consultado el 4 de agosto de 2015.
  15. ^ Shimpi, Anand Lal. "QuadCore de VIA: Nano se hace más grande". www.anandtech.com . Consultado el 10 de abril de 2020 .
  16. ^ "MCP (paquete multichip) | Samsung Semiconductor". www.samsung.com .
  17. ^ "MCP basado en NAND | Samsung Memory Link". samsung.com .
  18. ^ "MCP basado en e-MMC | Samsung Memory Link". samsung.com .
  19. ^ Cortadora, Ian. "Revisión de AMD Ryzen Threadripper 1950X y 1920X: CPU con esteroides". www.anandtech.com . Consultado el 10 de abril de 2020 .
  20. ^ Lilly, Paul (17 de diciembre de 2019). "AMD Ryzen Threadripper 3960X, 3970X se encuentran con Scalpel para la operación de eliminación de Zen 2". Hardware caliente . Consultado el 10 de abril de 2020 .
  21. ^ Cortadora, Ian. "Análisis de microarquitectura AMD Zen 2: Ryzen 3000 y EPYC Rome". www.anandtech.com . Consultado el 10 de abril de 2020 .

enlaces externos