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Silicio sobre aislante

En la fabricación de semiconductores , la tecnología de silicio sobre aislante ( SOI ) es la fabricación de dispositivos semiconductores de silicio en un sustrato de silicio-aislante-silicio en capas , para reducir la capacitancia parásita dentro del dispositivo, mejorando así el rendimiento. [1] Los dispositivos basados ​​en SOI se diferencian de los dispositivos convencionales fabricados en silicio en que la unión de silicio está sobre un aislante eléctrico , normalmente dióxido de silicio o zafiro (estos tipos de dispositivos se denominan silicio sobre zafiro o SOS). La elección del aislante depende en gran medida de la aplicación prevista, ya que el zafiro se utiliza para aplicaciones de radiofrecuencia (RF) y sensibles a la radiación de alto rendimiento, y el dióxido de silicio para reducir los efectos de canal corto en otros dispositivos microelectrónicos. [2] La capa aislante y la capa superior de silicio también varían ampliamente según la aplicación. [3]

Necesidad de la industria

La tecnología SOI es una de las diversas estrategias de fabricación que permiten la miniaturización continua de los dispositivos microelectrónicos , conocida coloquialmente como "extensión de la Ley de Moore " (o "Más Moore", abreviado como "MM"). Entre los beneficios informados de la SOI en relación con el procesamiento convencional de silicio ( CMOS a granel ) se incluyen: [4]

Desde una perspectiva de fabricación, los sustratos SOI son compatibles con la mayoría de los procesos de fabricación convencionales. En general, un proceso basado en SOI puede implementarse sin equipo especial o reequipamiento significativo de una fábrica existente. Entre los desafíos exclusivos de SOI se encuentran los nuevos requisitos de metrología para tener en cuenta la capa de óxido enterrada y las preocupaciones sobre la tensión diferencial en la capa de silicio superior. El voltaje umbral del transistor depende del historial de operación y el voltaje aplicado al mismo, lo que dificulta el modelado. La principal barrera para la implementación de SOI es el aumento drástico en el costo del sustrato, que contribuye a un aumento estimado del 10 al 15% en los costos totales de fabricación. [6] [ cita(s) adicional(es) necesaria(s) ] FD-SOI (silicio completamente agotado sobre aislante) se ha visto como una alternativa potencial de bajo costo a los FinFET. [7]

Transistores SOI

Un MOSFET SOI es un dispositivo transistor de efecto de campo de metal-óxido-semiconductor (MOSFET) en el que una capa semiconductora como silicio o germanio se forma sobre una capa aislante que puede ser una capa de óxido enterrado (BOX) formada en un sustrato semiconductor. [8] [9] [10] Los dispositivos MOSFET SOI están adaptados para su uso en la industria informática. [ cita requerida ] La capa de óxido enterrado se puede utilizar en diseños de SRAM . [11] Hay dos tipos de dispositivos SOI: MOSFET PDSOI (SOI parcialmente agotado) y FDSOI (SOI completamente agotado). Para un MOSFET PDSOI de tipo n, la película de tipo n intercalada entre el óxido de compuerta (GOX) y el óxido enterrado (BOX) es grande, por lo que la región de agotamiento no puede cubrir toda la región n. Entonces, hasta cierto punto, el PDSOI se comporta como un MOSFET a granel . Obviamente, existen algunas ventajas sobre los MOSFET a granel. La película es muy delgada en los dispositivos FDSOI, de modo que la región de agotamiento cubre toda la región del canal. En FDSOI, la compuerta frontal (GOX) admite menos cargas de agotamiento que el volumen, de modo que se produce un aumento de las cargas de inversión, lo que da como resultado velocidades de conmutación más altas. La limitación de la carga de agotamiento por parte de la BOX induce una supresión de la capacitancia de agotamiento y, por lo tanto, una reducción sustancial de la oscilación del subumbral, lo que permite que los MOSFET FD SOI funcionen con una polarización de compuerta más baja, lo que da como resultado una operación de menor potencia. La oscilación del subumbral puede alcanzar el valor teórico mínimo para MOSFET a 300 K, que es de 60 mV/década. Este valor ideal se demostró por primera vez mediante simulación numérica. [12] [13] Otros inconvenientes de los MOSFET a granel, como la caída de voltaje de umbral, etc., se reducen en FDSOI ya que los campos eléctricos de fuente y drenaje no pueden interferir debido a la BOX. El principal problema en PDSOI es el " efecto de cuerpo flotante (FBE)", ya que la película no está conectada a ninguna de las fuentes de alimentación. [ cita requerida ]

Fabricación de obleas SOI

Proceso SIMOX
Proceso de corte inteligente

SiO
2
Las obleas SOI basadas en silicio se pueden producir mediante varios métodos:

Una revisión exhaustiva de estos diversos procesos de fabricación se puede encontrar en la referencia [1].

Uso en la industria microelectrónica

IBM comenzó a utilizar SOI en el microprocesador de gama alta RS64-IV "Istar" PowerPC-AS en 2000. Otros ejemplos de microprocesadores construidos sobre tecnología SOI incluyen los procesadores AMD de 130 nm, 90 nm, 65 nm, 45 nm y 32 nm de uno, dos, cuatro, seis y ocho núcleos desde 2001. [21] Freescale adoptó SOI en su CPU PowerPC 7455 a finales de 2001, actualmente [ ¿cuándo? ] Freescale está enviando productos SOI en líneas de 180 nm, 130 nm, 90 nm y 45 nm. [22] Los procesadores de 90 nm basados ​​en PowerPC y Power ISA utilizados en Xbox 360 , PlayStation 3 y Wii también utilizan tecnología SOI. Sin embargo, las ofertas competitivas de Intel continúan [ ¿cuándo? ] ] para utilizar la tecnología CMOS convencional en masa para cada nodo de proceso, en lugar de centrarse en otros lugares como HKMG y transistores tri-gate para mejorar el rendimiento del transistor. En enero de 2005, los investigadores de Intel informaron sobre un láser Raman de guía de onda de nervadura de silicio de un solo chip experimental construido utilizando SOI. [23]

En cuanto a las fundiciones tradicionales, en julio de 2006 TSMC afirmó que ningún cliente quería SOI, [24] pero Chartered Semiconductor dedicó una fábrica entera a SOI. [25]

Uso en aplicaciones de radiofrecuencia (RF) de alto rendimiento

En 1990, Peregrine Semiconductor comenzó a desarrollar una tecnología de proceso SOI utilizando un nodo CMOS estándar de 0,5 μm y un sustrato de zafiro mejorado. Su proceso patentado de silicio sobre zafiro (SOS) se utiliza ampliamente en aplicaciones de RF de alto rendimiento. Los beneficios intrínsecos del sustrato de zafiro aislante permiten un alto aislamiento, alta linealidad y tolerancia a descargas electrostáticas (ESD). Muchas otras empresas también han aplicado la tecnología SOI a aplicaciones de RF exitosas en teléfonos inteligentes y radios celulares. [26] [ cita(s) adicional(es) necesaria (s) ]

Uso en fotónica

Las obleas SOI se utilizan ampliamente en la fotónica de silicio . [27] La ​​capa de silicio cristalino sobre el aislante se puede utilizar para fabricar guías de ondas ópticas y otros dispositivos ópticos, ya sean pasivos o activos (por ejemplo, mediante implantaciones adecuadas). El aislante enterrado permite la propagación de la luz infrarroja en la capa de silicio sobre la base de la reflexión interna total. La superficie superior de las guías de ondas se puede dejar descubierta y expuesta al aire (por ejemplo, para aplicaciones de detección) o cubrir con un revestimiento, generalmente hecho de sílice [28].

Desventajas

La principal desventaja de la tecnología SOI en comparación con la industria de semiconductores convencional es el aumento del costo de fabricación. [29] En 2012, solo IBM y AMD usaban SOI como base para procesadores de alto rendimiento y los demás fabricantes (Intel, TSMC, Global Foundries, etc.) usaban obleas de silicio convencionales para construir sus chips CMOS . [29]

Mercado SOI

A partir de 2020, se proyectaba que el mercado que utiliza el proceso SOI crecería aproximadamente un 15 % durante los próximos 5 años según el grupo Market Research Future. [30]

Véase también

Referencias

  1. ^ ab Celler, GK; Cristoloveanu, S. (2003). "Fronteras del silicio sobre aislante". Journal of Applied Physics . 93 (9): 4955. Bibcode :2003JAP....93.4955C. doi :10.1063/1.1558223.
  2. ^ Marshall, Andrew; Natarajan, Sreedhar (2002). Diseño de SOI: técnicas analógicas, de memoria y digitales . Kluwer. ISBN 0-7923-7640-4.
  3. ^ Colinge, Jean-Pierre (1991). Tecnología de silicio sobre aislante: materiales para VLSI . Springer. ISBN 978-0-7923-9150-0.
  4. ^ Méndez, Horacio (abril de 2009). "Silicon-on-insulator — SOI technology and ecosystem — Emerging SOI applications" (PDF) . Consorcio de la Industria SOI.
  5. ^ Kodeti, Narayan M. (octubre de 2010). "Implementación de silicio sobre aislante (SOI)" (PDF) . Libro blanco . Infotech. Archivado desde el original (PDF) el 18 de abril de 2013.
  6. ^ "IBM promociona tecnología para la fabricación de chips". cnet.com . 29 de marzo de 2001 . Consultado el 22 de abril de 2018 .
  7. ^ "Samsung, GF Ramp FD-SOI". 27 de abril de 2018.
  8. ^ US 6835633, "Obleas SOI con óxido de oxido enterrado de 30 a 100 ang. creadas mediante unión de obleas utilizando óxido fino de 30 a 100 ang. como capa de unión" 
  9. ^ US 7002214, "Dispositivos FET de pozo retrógrado súper inclinado (SSRW) de cuerpo ultrafino" 
  10. ^ Yang-Kyu Choi; Asano, K.; Lindert, N.; Subramanian, V.; Tsu-Jae King; Bokor, J.; Chenming Hu (mayo de 2000). "MOSFET SOI de cuerpo ultrafino para la era de las profundidades sub-décimas de micrón" (PDF) . IEEE Electron Device Letters . 21 (5): 254–5. doi :10.1109/IEDM.1999.824298. S2CID  43561939.
  11. ^ El documento US 7138685, "Vertical MOSFET SRAM cell" describe estructuras de óxido enterrado (BOX) SOI y métodos para implementar estructuras BOX SOI mejoradas 
  12. ^ Balestra, F. (1985). Caracterización y simulación de MOSFET SOI con control de potencial posterior (PhD). INP-Grenoble.
  13. ^ Balestra, F. (2016). "1.5 Desafíos para el funcionamiento de dispositivos semiconductores de potencia ultrabaja". En Lury, S.; Xu, J.; Zaslavsky, A. (eds.). Tendencias futuras en microelectrónica: viaje hacia lo desconocido . Wiley. págs. 69–81. doi :10.1002/9781119069225.ch1-5. ISBN 978-1-119-06922-5.
  14. ^ US 5888297, Atsushi Ogura, "Método de fabricación de sustrato SOI", publicado el 30 de marzo de 1999 
  15. ^ US 5061642, Hiroshi Fujioka, "Método de fabricación de semiconductores sobre aislantes", publicado el 29 de octubre de 1991 
  16. ^ Tong, Q.-Y.; Gösele, U. (1998). Unión de obleas semiconductoras: ciencia y tecnología . Wiley. ISBN 978-0-471-57481-1.
  17. ^ US 4771016, Bajor, George y otros, "Uso de un proceso térmico rápido para fabricar un semiconductor de silicio adherido con obleas", publicado el 13 de septiembre de 1988 
  18. ^ "SIGEN.COM". www.sigen.com . Consultado el 22 de abril de 2018 .
  19. ^ Yonehara, T; Sakaguchi, K. "Tecnología de obleas SOI novedosa ELTRAN®" (PDF) . Cutting Edge 2 . Canon.
  20. ^ Estados Unidos 5417180 
  21. ^ Vries, Hans de. "Chip Architect: los procesos de 130 nm de Intel y Motorola/AMD serán revelados". chip-architect.com . Consultado el 22 de abril de 2018 .
  22. ^ "NXP Semiconductors - Automotive, Security, IoT" (Semiconductores NXP: automoción, seguridad, IoT) www.freescale.com . Consultado el 22 de abril de 2018 .
  23. ^ Rong, Haisheng; Liu, Ansheng; Jones, Richard; Cohen, Oded; Hak, Dani; Nicolaescu, Remus; Fang, Alexander; Paniccia, Mario (enero de 2005). "Un láser Raman totalmente de silicio" (PDF) . Nature . 433 (7042): 292–4. doi :10.1038/nature03723. PMID  15931210. S2CID  4423069.
  24. ^ "TSMC no tiene demanda de tecnología SOI por parte de sus clientes". Fabtech: La fuente de información en línea para profesionales de semiconductores. Archivado desde el original el 28 de septiembre de 2007. Consultado el 22 de abril de 2018 .
  25. ^ Chartered amplía el acceso al mercado de fundición a la tecnología SOI de 90 nm de IBM
  26. ^ Madden, Joe. "RFFE de teléfonos móviles: MMPA, seguimiento de envolvente, sintonización de antena, FEM y MIMO" (PDF) . Expertos en telefonía móvil. Archivado desde el original (PDF) el 4 de marzo de 2016. Consultado el 2 de mayo de 2012 .
  27. ^ Reed, Graham T.; Knights, Andrew P. (5 de marzo de 2004). Fotónica de silicio: una introducción. Wiley. ISBN 978-0-470-87034-1. Recuperado el 22 de abril de 2018 – vía Google Books.
  28. ^ Rigny, Arnaud. "Sustratos de silicio sobre aislante: la base de la fotónica de silicio". Photonics.com . Consultado el 7 de mayo de 2023 .
  29. ^ ab McLellan, Paul. "Silicio sobre aislante (SOI)". Semiwiki . Consultado el 7 de marzo de 2021 .
  30. ^ Future, Market Research (17 de febrero de 2021). "Se prevé que el mercado de silicio sobre aislante (SoI) supere los 2400 millones de dólares en 2026 | La región APAC seguirá siendo pionera en la industria mundial del silicio sobre aislante". Sala de prensa de GlobeNewswire (nota de prensa) . Consultado el 7 de marzo de 2021 .

Enlaces externos