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Flujo de diseño (EDA)

Los flujos de diseño son la combinación explícita de herramientas de automatización de diseño electrónico para lograr el diseño de un circuito integrado . La ley de Moore ha impulsado toda la implementación de IC de RTL a flujos de diseño GDSII [ se necesita aclaración ] desde uno que utiliza principalmente algoritmos independientes de síntesis , ubicación y enrutamiento a flujos integrados de construcción y análisis para el cierre del diseño . Los desafíos del aumento de los retrasos en las interconexiones llevaron a una nueva forma de pensar e integrar las herramientas de cierre del diseño.

El flujo de RTL a GDSII experimentó cambios significativos desde 1980 hasta 2005. La ampliación continua de las tecnologías CMOS cambió significativamente los objetivos de los distintos pasos de diseño. La falta de buenos predictores de retrasos ha provocado cambios significativos en los flujos de diseño recientes. Los nuevos desafíos de escala, como la potencia de fuga, la variabilidad y la confiabilidad, seguirán requiriendo cambios significativos en el proceso de cierre del diseño en el futuro. Muchos factores describen qué impulsó el flujo de diseño desde un conjunto de pasos de diseño separados a un enfoque totalmente integrado, y qué cambios adicionales se avecinan para abordar los últimos desafíos. En su discurso de apertura en la 40ª Conferencia de Automatización del Diseño titulada Las mareas de EDA, Alberto Sangiovanni-Vincentelli distinguió tres períodos de EDA:

Existen diferencias entre los pasos y métodos del flujo de diseño para circuitos integrados analógicos y digitales. No obstante, un flujo de diseño VLSI típico consta de varios pasos como la conceptualización del diseño, la optimización del chip, la implementación lógica/física y la validación y verificación del diseño. [1] [2]

Ver también

Referencias

  1. ^ "Flujo de diseño ASIC en servicios de ingeniería VLSI: una guía rápida". 2019-06-04 . Consultado el 28 de noviembre de 2019 .
  2. ^ Basu, Joydeep (9 de octubre de 2019). "Desde el diseño hasta la grabación en tecnología de fabricación de circuitos integrados CMOS SCL de 180 nm". Revista de Educación IETE . 60 (2): 51–64. arXiv : 1908.10674 . doi :10.1080/09747338.2019.1657787. S2CID  201657819.