Los ASIC estructurados son una tecnología intermedia entre los ASIC y los FPGA , que ofrecen un alto rendimiento, una característica de los ASIC, y un bajo coste de NRE , una característica de los FPGA. El uso de ASIC estructurados permite introducir productos rápidamente en el mercado, tener un coste menor y diseñarlos con facilidad.
En un FPGA, las interconexiones y los bloques lógicos son programables después de la fabricación , lo que ofrece una gran flexibilidad de diseño y facilidad de depuración en la creación de prototipos. Sin embargo, la capacidad de los FPGA para implementar circuitos grandes es limitada, tanto en tamaño como en velocidad, debido a la complejidad del enrutamiento programable y al espacio significativo ocupado por elementos de programación, por ejemplo, SRAM , MUX . Por otro lado, el flujo de diseño de ASIC es costoso. Cada diseño diferente necesita un conjunto completo de máscaras diferente. El ASIC estructurado es una solución entre estos dos. Básicamente tiene la misma estructura que un FPGA, pero es programable por máscara en lugar de programable en campo, al configurar una o varias capas de vías entre capas de metal. Cada bit de configuración de SRAM se puede reemplazar por una opción de poner una vía o no entre los contactos de metal.
Varios proveedores comerciales han presentado productos ASIC estructurados. Tienen una amplia gama de posibilidades de configuración, desde una sola capa de vías hasta 6 capas de metal y 6 capas de vías. Hardcopy-II de Altera y Nextreme de eASIC son ejemplos de ASIC estructurados comerciales.
Véase también
Referencias
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Enlaces externos: eda.ee.ucla.edu/EE201A-04Spring/ASICslides.ppt
